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    06/20/2024, 01:00 AM UTC

    1、蓝珍珠软件庆祝其在2004年设计自动化会议上首次展示ASIC和FPGA静态验证解决方案20周年。2、Visual Verification Suite已发展成为提供ASIC、FPGA和IP RTL高级验证工具的套件,包括结构和形式化检查、约束生成以及针对毛刺和时钟域交叉的分析包。3、该套件还具有用于进度跟踪的管理仪表板,并与Accellera合作标准化CDC/RDC/Glitch意图捕获,解决了在不同验证环境中重用IP的挑战。

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    本文由大语言模型(LLM)生成,旨在为读者提供半导体新闻内容的知识扩展(Beta)。

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